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xavier nx载板设计问题

 
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free-jdx 发布于 2021-07-26 10:49:29 浏览 2378 点赞 91 收藏 0

1. 前言

目前正在为Jetson NX定制载体板,有几个问题:

(1)对输入电容似乎没有任何规定要求。我在开发套件设计中看到输入端有3 x 330uF的tant -poly 是否只要求有>= 990uF电容?

(2)计划使用Jetson Nano开发套件设计中使用的电源控制电路,而不是MCU,来控制NX的电源上/下顺序 有一个电路,允许一个按钮按下关闭Nano(附在下面) 我的理解是,只需将Nano的Power_EN信号设置为低就可以做到这一点 在不等待NX的SHUTDOWN_REQ*信号的情况下这样做是否会导致EMMC上的数据丢失或NX的损坏?

(3)如果不打算将超级电容或硬币电池与NX上的PMIC_BBAT引脚连接, 可以让它保持漂浮状态,还是应该连接电源?

(4)对于这个要求:

是否需要有和主动下拉绑定到SOC 1.8V逻辑轨道和SOC 3.3V逻辑轨道 或者只是需要确保载体板没有驱动任何I/O引脚到3.3V/1.8V后,NX已经关闭?

(5)对于上电顺序,在VDD_IN变得稳定和Power_EN设置高之间有最小延迟要求:

2. 问题梳理

(1)关于电容,可参考DLC 3中P3509原理图 (2)最好按照参考添加10s电源按钮电路,因为其他选项没有完全验证 (3)它可以保持浮动,但建议在第一个构建中添加未安装的垫 (4)这是模块内部的请求,对于载波板,只需要在模块之前关闭共享接口引脚 (5)由于VDD_IN通过一个5V DC/DC转换器 将产生一个良好的pgood使用,因此没有临界延迟要求

正计划实施相同的设计,但不会有延迟 它将由一个MCU来切换,而不是按按钮

(1)关于共享接口引脚,你是指3.3V和1.8V逻辑的共享接口引脚, 还是我们需要确保任何接口,例如USB设备/UART/I2C,在NX断电之前都是禁用的? (2)电路的目的是放在板上,确保没有外设通电

有几个高速接口,比如连接到NX的MIPI和PCIE设备,这些设备需要在NX启动和关闭之前下电吗? 这将需要我们有一个明显的延迟,以确保我们可以在我们的板上关闭所有连接到NX的设备, 并保持10ms的要求 POWER_EN被取消断言和SYS_RESET*被断言之间的时间是什么,如本节所述:

详细的电源顺序可参考Xavier和TX2在DLC中的设计指南 这个时间是在模块中,不是很严格,你可以把它当做几毫秒

3. 关于时间顺序问题

在NX开发套件上测量了两种情况下的断电顺序:SW关机和突然断电 在这两种情况下,它们都没有遵循时序图:

(1)对于SW关机,似乎时间不符合Power_EN的要求,在断言的Shutdown_REQ信号的10us范围内 (2)对于突然断电(拉直流插孔)Shutdown_REQ,从不断言之前Power_EN被取消断言 虽然情节是在800us division,但我确认在Power_EN之前没有更小的Shutdown _REQ*脉冲 看起来Power_EN依赖于Force_Off_N信号,但这不是来自NX

希望它能紧跟NX DG中规定的时间

4. 记录

在模块中,SHUTDOWN_REQ被直接切换为VDD_IN和SW_SHUTDOWN_N, 没有VDD_IN它不能是高的,也可以探测VDD_IN以确保它是低的

对于sw关机状态,我从终端发送了“须立即关机” 由于突然断电,我拔掉了直流插孔,拔掉了电源 VDD_IN在突然断电的情况下衰减,但是在Power_EN被取消断电之前, Shutdown_REQ上没有脉冲,看起来Force_Off_N信号检测断电的速度比NX更快, 因此它禁用电源而没有首先接收NX_Shutdown_REQ信号

关于突然掉电定时,在devkit上,FORCE_OFF_N是SHUTDOWN_REQ,为什么在定时图上把它们分开? 因为FORCE_OFF_N可以被SHUTDOWN_REQ_N拉低 但它也可以被蓝色框的电路拉低

模块中FORCE_OFF被切换为VDD_DCIN,而SHUTDOWN_REQ被切换为5V 所以VDD_DCIN丢失检测可以更早 正在检查DG中标记为<10us的定时值

*本文仅代表作者观点,不代表易百纳技术社区立场。系作者授权易百纳技术社区发表,未经许可不得转载。

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