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lufu  发布于  2008-08-26 00:30:25
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XCV50E芯片配置FPGA

FPGA
 
XCV50E芯片是基于静态RAM（SRAM）的FPGA，其配置信息必须固化到另外的可编程ROM（PROM）芯片中。系统加电后，XCV50E芯片首先从PROM中读取配置信息并加载到配置内存中。VirtexE系列芯片中支持四种配置模式，分别为主串行模式、从串行模式、并行模式和边界扫描模式。
　　XCV50E在主串行模式的配置电路图。图中配置模式选择位M2、M1、M0均连接到地；PROGRAM为FPGA配置控制信号；FPGA的配置数据输入管脚DIN连接到PROM芯片XC18V01的数据输出脚DATA；初始化指示信号INIT用作XC08V01的复位信号；配置完成信号DONE用作PROM的片选信号。配置过程如下：当系统加电并且PROGRAM首脚升高后，配置过程开始，XCV50E首先进行内部的初始经，初始化完成后，VCV50E释放INIT管脚，并从下一个配置时钟的上升沿开始从PROM中读入配置数据流；全部数据读完后，FPGA发出配置结束信号DONE来关闭PROM，配置过程结束。下一个时钟起，XCV50E运行启动进程，之后就可以按设定的程序工作了。
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