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qn1522720710

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qn1522720710 发布于 2020-04-28 11:11:00

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Hi3531A 如何硬件复用为SPI_CSN0

海思

HI3531AV100_PINOUT_CN.xlsx
有以下的说明：
3.WDG关键硬件复用关系
PIN_NAME POR_ENABLE=0 POR_ENABLE=1
WDG_RSTN WDG_RSTN SYS_RSTN_OUT

4.SPI_CS管脚硬件复用关系
PIN_NAME POWER_ON=0 POWER_ON=1
SPI_CSN0 SPI_CSN0 PCIE_STATA_MODE0
SPI_CSN1 SPI_CSN1 PCIE_STATA_MODE1
SPI_CSN2 SPI_CSN2 PCIE_STATA_MODE2
SPI_CSN3 SPI_CSN3 PCIE_STATA_MODE3

各位大佬，请教下：
查看硬件管脚POR_ENABLE是存在的，而POWER_ON是不存在的，那么要如何才能硬件复用为SPI_CSN0？

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qn1522720710

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qn1522720710 2020-04-29 10:11:29

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本帖最后由 qn1522720710 于 2020-4-29 10:12 编辑

我个人理解是这样的，不知道对不对？
POWER_ON=0 表示加一个拉低信号
POWER_ON=1 表示加一个拉高的信号

zhuangweiye

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zhuangweiye 2020-04-29 10:42:17

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[quote][url=forum.php?mod=redirect&goto=findpost&pid=157559&ptid=80063]qn1522720710 发表于 2020-4-29 10:11[/url]
我个人理解是这样的，不知道对不对？
POWER_ON=0 表示加一个拉低信号
POWER_ON=1 表示加一个拉高的信号[/quote]

power_on = 1 表示上电时

qn1522720710

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qn1522720710 2020-04-29 11:35:01

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[quote][url=forum.php?mod=redirect&goto=findpost&pid=157560&ptid=80063]zhuangweiye 发表于 2020-4-29 10:42[/url]
power_on = 1 表示上电时[/quote]

设计是用SPI与FGPA通讯，用SPI_CSN0做片选，FPGA那边一直检测到是拉低的。
请教下SPI_CSN0要怎么控制？

celinessl

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celinessl 2020-10-26 11:52:03

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本帖最后由 celinessl 于 2020-10-26 11:55 编辑

请问楼主，SPI_CSN0 怎么控制了？
上电拉低，表明这个管脚已经是SPI_CSN0功能。但是我要怎么控制这个管脚的电平那？
这个管脚没有个GPIO复用，请问通过什么寄存器可以控制？

qn1522720710

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qn1522720710 2020-10-30 09:08:23

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[quote][url=forum.php?mod=redirect&goto=findpost&pid=163063&ptid=80063]celinessl 发表于 2020-10-26 11:52[/url]
请问楼主，SPI_CSN0 怎么控制了？
上电拉低，表明这个管脚已经是SPI_CSN0功能。但是我要怎么控制这个管脚 ...[/quote]

使用spi的规范去设置spi的模式，spi-cs就能正常了