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yinfei103  发布于  2018-12-24 14:57:34
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这两幅图，一个引脚是导出来的，一个引脚是没导出来的，导出来的是怎么操作的？

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这两幅图，一个引脚是导出来的，一个引脚是没导出来的，导出来的是怎么操作的？
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lcj64 2018-12-24 14:58:05
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右键，make extern
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yinfei103 2018-12-24 14:58:52
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[quote][url=forum.php?mod=redirect&goto=findpost&pid=117817&ptid=55830]lcj64 发表于 2018-12-24 14:58[/url]
右键，make extern[/quote]

多谢！还有一个问题，就是添加verilog程序，如何把verilog程序和这个模块关联起来？
lcj64

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lcj64 2018-12-24 15:00:19
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[quote][url=forum.php?mod=redirect&goto=findpost&pid=117818&ptid=55830]yinfei103 发表于 2018-12-24 14:58[/url]
多谢！还有一个问题，就是添加verilog程序，如何把verilog程序和这个模块关联起来？[/quote]

右键 ，creat HDL wrapper
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yinfei103 2018-12-24 15:01:11
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[quote][url=forum.php?mod=redirect&goto=findpost&pid=117819&ptid=55830]lcj64 发表于 2018-12-24 15:00[/url]
右键 ，creat HDL wrapper[/quote]

比如我要编写一个verilog，这个verilog和图中的模块关联，我是这个意思？就是如何编写某个模块的verilog程序？
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lcj64 2018-12-24 15:01:48
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[quote][url=forum.php?mod=redirect&goto=findpost&pid=117820&ptid=55830]yinfei103 发表于 2018-12-24 15:01[/url]
比如我要编写一个verilog，这个verilog和图中的模块关联，我是这个意思？就是如何编写某个模块的verilog ...[/quote]

就是这样弄
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yinfei103 2018-12-24 15:02:29
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[quote][url=forum.php?mod=redirect&goto=findpost&pid=117821&ptid=55830]lcj64 发表于 2018-12-24 15:01[/url]
就是这样弄[/quote]

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