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ww0705  发布于  2018-12-30 13:36:09
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别人cadence画的图，转成AD之后，显示图在AD的边界外（无法正常显示）如何解决？

Xilinx
 
FPGA
 
别人cadence画的图，转成AD之后，显示图在AD的边界外（无法正常显示）如何解决？
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