zxj123
zxj123

zxj123

0个粉丝

92

问答

0

专栏

0

资料

zxj123  发布于  2012-12-24 14:40:40
采纳率 0%
共92个问答
2511
  • 收藏
  • 点赞
  • 分享
  • 举报

FPGA 每次上电时，要从PROM 中读取配置信息，那么一定需要时钟，该时钟是从哪里来的呢

ST
 
问：FPGA 每次上电时，要从PROM 中读取配置信息，那么一定需要时钟，该时钟是从哪里来的呢？
FPGA 是否存在一个时钟振荡器来提供这一时钟？
答：master 的FPGA 的cclk 脚在上电的时候会自动产生配置时钟，这个时钟应该是内部rc 电路产生的( 个
人猜测)，如果是由外部晶振产生的话，那没有晶体的系统( 比如差分接受数据) 不就用不了FPGA 了？
数据手册中有写： Master Slave 主串 方式下 FPGA 自己产生时钟。不需要外接RC。
我来回答
回答0个
时间排序
认可量排序
易百纳技术社区暂无数据
添加附件 添加网盘链接
或将文件直接拖到这里
悬赏：
E币
网盘
* 网盘链接：
* 提取码：
悬赏：
E币

Markdown 语法

  • 加粗**内容**
  • 斜体*内容*
  • 删除线~~内容~~
  • 引用> 引用内容
  • 代码`代码`
  • 代码块```编程语言↵代码```
  • 链接[链接标题](url)
  • 无序列表- 内容
  • 有序列表1. 内容
  • 缩进内容
  • 图片![alt](url)
+ 添加网盘链接/附件

Markdown 语法

  • 加粗**内容**
  • 斜体*内容*
  • 删除线~~内容~~
  • 引用> 引用内容
  • 代码`代码`
  • 代码块```编程语言↵代码```
  • 链接[链接标题](url)
  • 无序列表- 内容
  • 有序列表1. 内容
  • 缩进内容
  • 图片![alt](url)
相关问答
无更多相似问答 去提问
易百纳技术社区
点击登录
-- 积分
-- E币
提问
—
收益
—
被采纳
—
我要提问
社区问答
悬赏问答
举报反馈

举报类型

  • 内容涉黄/赌/毒
  • 内容侵权/抄袭
  • 政治相关
  • 涉嫌广告
  • 侮辱谩骂
  • 其他

详细说明

提醒
你的问题还没有最佳答案，是否结题，结题后将扣除20%的悬赏金
取消
确认
提醒
你的问题还没有最佳答案，是否结题，结题后将根据回答情况扣除相应悬赏金（1回答=1E币）
取消
确认
易百纳技术社区