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k0000000k 发布于 2019-01-23 10:23:37

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请问要设计如下一套系统，这样的方案执行效率怎么样？

Xilinx

FPGA

请问要设计这样一套系统，Cortex核、硬件加速器、SDRAM挂载AHB上，把摄像头采回来的数据先存到SDRAM里后，硬件加速器再从SDRAM里读取数据去处理，然后Cortex核从SDRAM里读出数据再LCD上做显示。Cortex和硬件加速器通过SRAM进行通信。这样的方案执行效率怎么样？

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primuszc

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primuszc 2019-01-23 10:24:49

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还不fpga直接搞。也比软处理器核快

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k0000000k 2019-01-23 10:25:41

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[quote][url=forum.php?mod=redirect&goto=findpost&pid=122789&ptid=57441]primuszc 发表于 2019-1-23 10:24[/url]
还不fpga直接搞。也比软处理器核快[/quote]

我刚开始想的是硬件加速器写完的数据回写到SDRAM里，再让Cortex核去读
但Cortex核不仅要读视频的图像数据要做显示，而且还需要读图像处理完的数据

月落西山

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月落西山 2019-01-23 10:26:23

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[quote][url=forum.php?mod=redirect&goto=findpost&pid=122790&ptid=57441]k0000000k 发表于 2019-1-23 10:25[/url]
我刚开始想的是硬件加速器写完的数据回写到SDRAM里，再让Cortex核去读
但Cortex核不仅要读视频的图像数 ...[/quote]

写个ahb转sdram的接口挂上就行了

k0000000k

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k0000000k 2019-01-23 10:27:37

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[quote][url=forum.php?mod=redirect&goto=findpost&pid=122791&ptid=57441]月落西山发表于 2019-1-23 10:26[/url]
写个ahb转sdram的接口挂上就行了[/quote]

意思是存储只用一个SDRAM，不用SRAM再和Cortex核做通信也可以吗？

月落西山

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月落西山 2019-01-23 10:28:33

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[quote][url=forum.php?mod=redirect&goto=findpost&pid=122792&ptid=57441]k0000000k 发表于 2019-1-23 10:27[/url]
意思是存储只用一个SDRAM，不用SRAM再和Cortex核做通信也可以吗？[/quote]

挂在软盒的总线上加速器只是个计算单元