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主题396

回复425

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Xilinx VIVADO Vitis

FPGA上实现网络通信用的什么协议？
Xilinx FPGA

salem83 发布于2019年01月18日
AI-海king 回复于2023-10-16 18:48:20

11 3.4k
在Ubuntu20.04系统中，如何将Vivado编辑器配置成Vim?
Ubuntu系统 VIVADO

虽万人吾往矣发布于2023年02月06日
畅知识的海洋回复于2023-08-04 17:29:32

2 1.3k
请问下大家，你们vivado在哪里下载的啊？网上找了一个没装成功
Xilinx FPGA

primuszc 发布于2018年12月02日
我想境境回复于2023-03-15 23:36:32

6 5.2k
给了时许约束后，是否还需要给时钟分配一个引脚约束呢？
Xilinx FPGA

明熙发布于2019年01月07日
易百纳用户01878 回复于2023-03-14 09:29:14

3 4.3k
zynq 微相，米尔，黑金有啥区别，哪个稳定些？
Xilinx FPGA

yyyxxx0088 发布于2019年01月07日
Lupho 回复于2023-03-14 08:56:14

1 3.7k
FPGA器件选型研究
Xilinx FPGA

qn1596531537 发布于2020年10月22日
Lupho 回复于2023-03-14 08:46:55

2 5.2k
如何使用vivado仿真zynq7000ov5640程序呢？
VIVADO

虽万人吾往矣发布于2023年02月08日

0 1k
关于altera系列芯片FIR IP核在使用过程中的问题
ARM Xilinx

虽万人吾往矣发布于2023年02月03日

0 1.3k
这个fifi能存多少字节数据，有人知道吗？
Xilinx FPGA

mfjsxz 发布于2018年12月12日
梦龙回复于2022-05-15 22:25:32

2 4.2k
Xilinx 7系列FPGA收发器用户指南
Xilinx FPGA

lock_lilu 发布于2021年09月06日
wenlinux 回复于2022-04-11 10:36:49

2 4.5k
有人申请过xilinx第三方的ip核吗？
Xilinx

鲸落发布于2020年10月31日
Maun Mo 回复于2022-04-06 15:32:33

3 4.2k
求教大神 Artix7系列怎么输出差分时钟？
Xilinx FPGA

chenbin 发布于2018年11月30日

0 5.2k
FPGA运算加速平台成新宠 Xilinx、Altera各有支持者
Xilinx FPGA

qn1596531537 发布于2020年09月23日
qn1596531537 回复于2020-10-09 17:53:53

1 4.4k
请问一下，Vivado能自动补齐关键字吗？用起来好不习惯
Xilinx FPGA

LEXE 发布于2019年01月23日
李锐博恩回复于2020-12-02 13:45:28

2 8.2k
请教车牌识别FPGA问题
Xilinx

科学民主自由发布于2021年04月09日
科学民主自由回复于2021-04-19 18:37:46

3 3.7k
请教一下有没有做车牌识别FPGA的，推荐一下
Xilinx 硬件设计

焦糖布丁发布于2021年04月09日

0 3.5k
请问哪里可以买到SLVS-EC的IP核？
FPGA Xilinx

阿述9362 发布于2020年12月30日

0 3.9k
请问出现这种警告是什么原因？
Xilinx FPGA

tigercat 发布于2019年01月29日
李锐博恩回复于2020-12-02 22:05:15

1 4.1k
想问下，vivado中如何更新ip核呀，各位大佬？
Xilinx FPGA

zxslhyzrf 发布于2018年11月30日
李锐博恩回复于2020-12-02 21:56:48

1 5.1k
请教下，0X4000_0000 与0X40000000 地址有什么不一样吗？
Xilinx FPGA

rcerk 发布于2018年12月03日
李锐博恩回复于2020-12-02 21:54:23

1 4.1k
各位，请问iSe选这个吗？
Xilinx FPGA

沙儿菲菲发布于2018年12月10日
李锐博恩回复于2020-12-02 21:53:47

1 4.3k
大家好，请问谁知道这是什么错误？
Xilinx FPGA

valen2000 发布于2018年12月18日
李锐博恩回复于2020-12-02 21:51:31

1 3.7k
请问各位这个报错怎么引起的啊？
Xilinx FPGA

wangzt 发布于2018年12月18日
李锐博恩回复于2020-12-02 21:50:31

1 3.8k
请问有人遇到过非法指令错误的么？如何解决的？
Xilinx FPGA

zzzzzx 发布于2018年12月24日
李锐博恩回复于2020-12-02 21:49:13

1 3.6k
为什么我在vivado的IP库中看不到HDMI IPcore？我用的是ZedBoard
Xilinx FPGA

小小妹仔发布于2018年12月27日
李锐博恩回复于2020-12-02 21:47:52

1 3.8k
请问XiLinx的pll生成的多个时钟上升沿是否对齐？
Xilinx FPGA

sailshadow 发布于2018年12月27日
李锐博恩回复于2020-12-02 21:46:45

1 3.7k
有没有大佬知道这个怎么回事？烧mcf烧不进去
Xilinx FPGA

y130103 发布于2019年01月04日
李锐博恩回复于2020-12-02 21:45:11

1 3.6k
有人调试过Xilinx的Aurora吗？channel up信号时钟不拉高怎么办？
Xilinx FPGA

flyman46 发布于2019年01月08日
李锐博恩回复于2020-12-02 21:41:56

1 1.1w
请问是否一个时钟的脉冲很容易采不到？
Xilinx FPGA

srici_yb 发布于2019年01月07日
李锐博恩回复于2020-12-02 21:40:55

1 3.9k
我的SDK调试可以用，但生成bin不能用怎么办？
Xilinx FPGA

y130103 发布于2019年01月08日
李锐博恩回复于2020-12-02 21:39:08

1 4.3k
用vivado打开modelsim的时候一直打不开是怎么回事？
Xilinx FPGA

valen2000 发布于2019年01月11日
李锐博恩回复于2020-12-02 21:37:04

1 4.5k
请问有谁用过fifo generator？
Xilinx FPGA

fengyuan19 发布于2019年01月11日
李锐博恩回复于2020-12-02 21:35:24

1 3.9k
请问图里的(* *)是个啥？
Xilinx FPGA

li00020 发布于2019年01月18日
李锐博恩回复于2020-12-02 20:24:55

1 3.7k
请问一下大佬们，下面这个是怎么弄出来的
Xilinx FPGA

tvmnu 发布于2019年01月23日
李锐博恩回复于2020-12-02 20:23:00

1 4.1k
综合的时候经常报内存不足的问题，请问大家有啥办法解决吗
Xilinx FPGA

aking 发布于2019年01月23日
李锐博恩回复于2020-12-02 20:19:37

1 3.4k
请问各位这是什么错误？
Xilinx FPGA

Laken 发布于2019年01月22日
李锐博恩回复于2020-12-02 17:56:45

1 3.6k
请问用vivado的什么版本比较好啊我这个下载不下来有前辈知道为什么不能下载吗
Xilinx FPGA

jgbl 发布于2019年01月26日
李锐博恩回复于2020-12-02 17:21:39

3 4.2k
请问如何下载xilinx官方开发板的相关示例程序？
Xilinx FPGA

ownpy 发布于2019年01月25日
skywell 回复于2020-11-27 14:44:18

1 4.4k
zedboard 的JTAG 上USB线插到电脑上没有反应是怎么回事？
Xilinx FPGA

lananrun 发布于2019年01月29日
skywell 回复于2020-11-27 14:42:01

1 3.9k
DY-VC-2020-01视频切换模块(KVM)
Xilinx FPGA

qn1525681036 发布于2020年11月25日

0 3.7k

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