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HI3518EV300电源设计参考
易百纳技术社区 杨大大 2022-06-10 21:02:09

HI3518EV300电源设计参考
1.CORE电源设参考
(1)Hi3518EV300 的 CORE 电源 VDD,典型电压 0.9V,具体输出电压由 SVB 电路控制。
(2)电源芯片选型要求其供电能力不小于 1A,要求使用非轻载高效器件。电感感值不低于1uH,饱和电流建议不低于1.5A。
(3)纹波噪声要求约束在 Vpp 70mv 以内。
2.DDR电源设计参考
(1)Hi3518EV300 内置 DDR2,典型 IO 电压 1.8V。
(2)DDR PLL 电源(管脚名 AVDD33_DDR_PLL):连接 3.3V 电源。必须使用磁珠(1kΩ@100MHz)和主芯片的数字 3.3V 电源进行隔离,纹波噪声要求约束在Vpp 80mv 以内,要求不能有固定频点噪声。
(3)电源器件选型,要求使用非轻载高效器件。
3.IO电源设计参考
(1)IO 电源连接数字 3.3V/1.8V 电源。
(2)Sensor 时钟、复位和配置管脚 IO 电源支持3.3V/1.8V 电源,实际连接的电源要与对接芯片的接口电平保持一致。
(3)MIPI/LVDS 接口电源支持 3.3V/1.8V 电源。
Hi3518EV300 的 MIPI/LVDS 管脚可以复用成 Parallel Data 功能,电平支持3.3V/1.8V,实际连接的电源要与对接芯片的接口电平保持一致。
(4)LCD 接口电源(管脚名 DVDD3318_VIVO):支持 3.3V/1.8V 电源。
(5)纹波噪声要求约束在 Vpp 80mv 以内,建议使用非轻载高效器件。
4.PLL电源设计参考
Hi3518EV300 的 PLL 电源有 2 个,分别是:AVDD_PLL和AVDD33_PLL,设计要求有:
(1)AVDD_PLL:设计上必须用磁珠(1kΩ@100MHz)对 DVDD 电源进行隔离。
(2)AVDD33_PLL:设计上必须用磁珠(1kΩ@100MHz)对数字 3.3V 电源进行隔离。
(3)AVDD_PLL 纹波噪声要求约束在 Vpp 70mv 以内。
(4)AVDD33_PLL 纹波噪声要求约束在 Vpp 70mv 以内。
5.上下电时序要求
Core 电源、DDR 电源和 IO 电源有上下电时序的要求,如图所示:
(1)上电时序

(2)下电时序

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